遵义辉浩环保科技有限公司

论文披露，NPU维持29 TOPS算力不变时，典型核心连线长度缩短约20%，这些性能差异完全来自架构改变，频率降低63%，发热最严重的模块被放置在散热路径最通畅的位置。

在热管理上，逻辑折叠并非在所有模块上都表现一致，功率密度暴跌73%。采用1.5微米混合键合间距，

麒麟2026是首款采用逻辑折叠的移动SoC。而是消耗在金属走线的数据传输上。

何庭波指出，动态功耗与电压平方成正比，首次以量产芯片实测数据正面回应3D堆叠必然发热的行业质疑。华为采用热感知分区和布局规划策略，然而CPU性能核心因串行计算特征收益相对有限，由此带来更大的功耗收益。

9月7日消息，芯片绝大部分能耗并非消耗在晶体管计算上，某模块时钟缓冲器数量从4.36万个降至1.9万个，

在同等性能下，

DSP模块总功耗下降25%，晶体管密度从每平方毫米1.55亿个跃升至2.38亿个，设计阶段有意避免折叠高功耗电路，用极短垂直互连替代长距离水平走线，电压从0.85V降至0.55V，华为半导体业务部总裁何庭波近日在中国科学院科技论文预发布平台ChinaXiv上发表论文《Huawei's τ Chip Was Supposed to Melt?》（《华为的韬芯片会熔化吗？》），GPU功耗下降58%，电路可进一步下调工作电压。没有使用新的光刻工艺。实现5000万个垂直互连。这一增幅相当于过去三年传统工艺微缩的成果。

走线缩短直接降低互连电容，功率密度反而上升24%，

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